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一种低噪高输出电压DC—DC变换器设计
发布时间:2015-09-11 阅读：次 [打印文章] [关闭窗口]-
如前所述两级滤波器有一个设功率电大电流电感感置策略问题，如果第一级无源滤波器的截止频率设置太低，则滤波器的体积较大，并且对于空间应用来说，高压滤波电容的选择受到限制，钽电容的容量较大，但最高耐压100 V，考虑降额及避免单点失效的影响，需要3个电容串联使用，这会使得有效电容量电感器标准降低，ESR成倍增加。因此综合考虑，本文设计的输出具差模电感器有两级滤波器的隔离式DC—DC变换器将第一级无源滤波器的截止频率设计的较高，而第二级有源滤波的电容一般选取高贴片电感器频特性比较好的陶瓷电容，不但实现低噪输出，而且滤波器的体积较小，所用原器件的应力较小，可靠性较高，可以满足空间应用。基于流水线技术的并行高效FIR滤波器设计摘要：基于流水线技术，利用FPGA进行并行可重复配置高精度的FIR滤波器设计。使用VHDL可以很方便地改变滤波器的系数和阶数。在DSP中采用这种FIR滤波器的设计方法可以充分发挥FPGA的优势。数字滤
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