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多并行处理器接收机设计与实现

• 摘要：为满足对卫星信号处理越来越快的速．度及通用性的要求，设计并实现了一款高性能的卫星接收机。该接收机的设计在原理上采用多并行处理器的思想，因卫星接收机的中频处理数据量大，实时性高。这样，对芯片的选型提出了很高的要求，通过比较选择了两片目前业界处理能力强的DSP芯片TMS320C6416T核心计算单元，并结合使用了两片功耗低，成本低和大容量的FPGA芯片EP3C120完成卫星接收机中的数据处理，从而使接收机的处理速度和处理能力大大提高，满足了处理高实时性和大数据量卫星信号的要求。
  关键词：DSP；FPGA；多并行处理器；卫星接收机

  
  0 引 言
  在航空、航天领域，扩频接收机对信号处理速度的要求不断提高。同时，鉴于当前单一处理器导航接收机结构给导航算法带来的约束及并行多处理器技术的日益成熟，为了避免专用卫星接收机的重复研制工作，降低研制的难度、成本和周期，提高可靠性，近几年这一领域中提出了多并行处理器通用接收机硬件平台的思想。基于这一思想，本文的接收机设计在文献[1]的基础上做了一些改大功率电感贴片电感器进，采用了两片DSP芯片TMS3206416T(以下简称C6416)和两片FPGA芯片EP3C120的设计方案。这样，完成各种不同的信号处理任务可以采用完全统一的硬件平台，所不同的只是该硬件平台上运行的软件。这就增加了系统的灵活性和硬件平台的通用性，并解决了不同信号处理任务分配的问题。

  
  1 接收机板的总体描述
  接收机板的原理图框图如图1所示，板上资源及性能指标如表1所示。

  

  板上有两片C6416T，它们在结构上完全对称，描述上称两片C6416T及其外围资源为C6416T模块。C6416T模块中对称的结构决定了两片C6416T既可以是串行流水方模压电感器式的并行计算，也可以是并发操作方式的并行计算，具体的方式由接收机板完成的算法来决定。两片C6416T通过双端口存储器(DPRAM)以共享存储器的方式耦合在一起，来完成处理时两者之间的数据共享和通讯。双口存储器数据总线宽度为64 b，容量为9 Mb。另外，两片C6416T之间还可以通过多功能串口(McBSP)进行数据传输，而且每片C6416T外围配备有1 024 Mb的SDRAM和64 Mb的FLASH。其中，大容量的SDRAM可用来暂存大量的中间处理数据；大容量的FLASH可用来存储大量的程序和非易失性数据。这里设计的存储器最大存储容量比较大，主要是基于通用性的考虑，配备不同容量时可以满足不同的应用需求，这可根据实际的情况而定。除此之外，板上还有两片3C120及其外围资源，描述上将其称为3C120模块。3C120模块中两片3C120之间也通过9 Mb的DPRAM来完成两者之间的数据共享和通信，而且两片3C120之间还通过自定义I／O扩展总线接口来进行数据通信与传输。另外，每片3C120与各自平行对应的C6416T之间通过EMIFA总线和SPI进行数据传输，与所对应的两路10 b ADC相连，以完成对接收中频数据的采样。

  
  2 模块的设计
  接收机板中，C6416T和3C120是核心器件，其他器件都是外设，以下的描述将围绕C6416T和3C120两个模块展开。
  C6416T模块中主要的外设都与EMIF相连接，所以外设接口的设计主要介绍EMIF的设计。C6416T有两个EMIF接口，EMIFA的外总线上连接了FPGA，SDRAM和DPRAM，它们的数据宽度都是64 b。出于信号完整性考虑，外总线通过匹配电阻来解决信号反多层片式电感器射的问题。FPGA用同步时序访问，SDRAM和DPRAM都是同步器件，它们被直接连接到临近EMIFA口这一级总线上，这一级总线的访问速率高，称为高速总线。EMIFA的每个CE空间最大的存储管理能力是256 M一体成型电感器b，外接4片32 b数据宽度、512 Mb的SDRAM时，可以达到这个最大容量，本设计电路中每个C6416T用了两片32 b数据宽度、512 Mb的SDRAM，占用一个CE空间，共1 024 Mb。另外，所选DPRAM芯片数据宽度为72 b，为了能与EMIFA总线匹配，在电路设计中将DPRAM的数据线每取8 b就间隔1 b，一体成型电感器这样就得到64 b的数据宽度。
  EMIFB的外总线上连接了FLASH，它的数据宽度为16 b，存储容量为64 Mb。因为EMIFB对8 b的异步存储设备的管理能力只有1 Mb，所以接8 Mb的FLAsH需要做地址扩展，这个扩展功能在CPLD中完成。在该接收机板中EMIFB的BCE1空间所对应的16 Mb FLASH用来做8 b Bootloader，剩余的48 MbFLASH用来存储重要数据。每个C6416T的EMI-FA和EMIFB的存储空间分配如图2和图3所示。

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