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如何发现并解决FPGA设计中的时序问题
发布时间:2018-04-22 阅读：次 [打印文章] [关闭窗口]
设计的底层规划是一个需要深度交互的过程。你可能会发现需要反复多次调整区域组才能够达到目标。请记住有时创建的区域组越小越少越好。你并不是总需要将整个模块固定为区域组。集中于时序失败的基本单元，将它们组合为区域组并单独为其进行底层规划。
在此过程中，应当利用Pblock指标(Metrics)来更好地理解有关功能，如区域组中可配置的逻辑块(CLB)的利用情况如何(可以在PlanAhead软件左上窗口中点击Metrics标签来查看可用的指标)。这可帮助确定是否某个特定区域中太拥挤以致妨碍布线。如果确实比较拥挤，可能需要通过平面规划将设计逻辑放得散开一些。
一旦利用PlanAhead软件获得尽可能好的时序分数，最后的任务就是优化代码。PlanAhead设计工具现在支持HDL源文件。根据你导入的源文件不同，你可以从时序问题出发通过交叉探查功能大电流电感回查到网表或HDL。
利用原理图观察窗(Schematic view)，可以察看整个时序路径。只需要从时序结果中选择时序路径并按F4。仔细观察从其他模块扇入共模电感扇出的逻辑。由于外部接口要求，工具可能经常需要将模块在芯片上散开模压电感部署。如果是这样，可能需要使用流水线。
Bl贴片电感ock RAM和DSP输出时序是引起时序问题的常见原因。通过在这些模块的电感器的型号输出进行存储，通常可以恢复一纳秒甚至更多的时间。[稳压电源](附图)开关三极管,BC极并联了个电阻,本帖最后由970253146于2016-3-3023:05编辑
想请问一下，这个三极管在这为什么要在BC极上接一个电阻。
这里的三极管是做开关管的，而不是放大。
而且是NPN管。
还没见过，开关管都基于TMS32OLF24O7A的教育机器人硬件系统设计摘要：本论文的主要目的就是设计一种基于DSP的模块化教育机器人硬件系统。该教育机器人是以智能小车为载体基于 TMS320LF2407A微控制器的嵌入式控制平台及编程环境的一款开放式的机器人控制系统，以
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