2 器件简介及其配置
2.1 AD9516简介
AD9516是一款集低相位噪声时钟发生和低抖动14通道时钟分配功能于一体的时钟分配器。其内部集成1个整数N分频的频率合成器、2个参考输入端、1个压控振荡器(VCO)、可调延迟线和14个时钟驱动器,还包括LVPECL、LVDS和CMOS输出。另外,片内集成的VCO可提高系统可靠性。14个输出通道分别为6路(3对)时钟可高达1.6 GHz的LVPECL输出和4路(2对)时钟高达800 MHz的LVDS输出,LVDS时钟输出可选为高达200 MHz的两通道CMOS输出。
2.2 引脚说明及外围电路配置
REN_SEL:参考选择。A电感厂家D9516有REFl和REF2两个参考时钟输入端,该引脚用于定义系统是采用REFl输入(拉低)还是REF2(拉高)的参考信号。
SCLK,CS,SDI0,SD0:串口同步I/0,与SPI协议相兼容,实现与AD9516内部寄存器的通信。其中SCLK为时钟输入;CS为片选信号;SDIO为主机输出/AD9516输入(SCLK的上升沿),或者主机输入/AD9516输出(SCLK的下降沿);SDO为主机输入/
AD9516输出。
REFMON,LD,STATUS:状态输出,用于测试AD9516内部信号。通过改变0x17,0x1A,0xlB(内部寄存器的地址)3个寄存器.测试VC0及分频器的输出时钟,获得当前AD9516工作状态。
LF,CP:外部环形滤波,可向内部VCO提供反馈电压。
OUT6,OUT6,0UT7,O空心电感UT7,0UT8,OUT8,OUT9,OUT9:输出四路LVDS时钟,可向A/D转换器提供采样时钟。
以上为AD9516主要引脚的功能描述,还有一些包括输入电压,复位等引脚的功能描述可见参考文献。根据上述主要引脚描述,给出了AD9516的外同电路配置图,如图l所示。
2.3 内部寄存器配置
AD9516可设置3种工作模式,包括外部VC0、外部CLK以及内部VC0。本系统设计采用内部VCO和参考输入频率工作模式。
2.3.1 PLL的工作原理
参考输入(REFl输入)先经R分频模块(14位寄存器),再通过R延时模块(延时可调节)后进入PFD(相位/频率监测)模块一端,同时VCO产生的信号通过N分频模块(预分频模块P.P+1和A/B计数模块)和N延时模块(延时可调)后进入PFD的另一端;PFD用于比较两信号的频率和相位差.产生与之成比例的信号传输给CP(电荷泵),电荷泵通过外接环形滤波器连接至VC0的控制端。电荷泵根据PFD的信号对环形滤波器的连接节点充(放)电以达到VCO电压调节目的,使VCO输出和参考输入与PFD的频率和相位完全匹配,此时锁存相位,输出同步。
2.3.2 分频寄存器的配置
除了PLL用于产生稳定的VCO所涉及的寄存器R,A和B外,分频寄存器还包括时大电流电感钟输出分频寄存器,每对儿输出通道的分频寄存器。时钟输出分频器可以随意设置为2~6中的任意整数,输出通道的每个分频器可选用1~32中的任意整数作为分频参数。需要注意的是:PLL的R、A和B这3个寄存器的配置相互制约,必须合理配置VCO才能工作在由参考输入提供的频率范围内,否则将导致不能锁存锁相模块。这些制约包括:PFD(相位/频率监测)输入频率范围、A和B计数模压电感器输入最高频率、A和B值大小。设计时,考虑到这些制约以及设计的需要就能正确配置内部分频寄存器。
2.3.3 输出相位寄存器配置
调整输出相位:包括相位延时粗调和相位延时细调。
(1)相位延时粗调
由于系统要求相差为90塑封电感76;的四路110 MHz采样时钟。OUT6作为相位的基准信号,则OUT7相对延时90°,OUT8相对延时180°,OUT9相对延时270°。由于四路LVDS输出是2对,每对共用2个分频器。OUT6与OUT7共用,OUT8与OUT9共用。AD9516的分频器可选用相位延时,因此,可把OUT8与OUT9共用的分频器设置为相位延时180°,则在相位细调时,只需调整0UT7延时90°,OUT9延时90°即可。
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