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赛灵思推出 Vivado 设计套件工程师观点
发布时间:2017-11-11 阅读：次 [打印文章] [关闭窗口]-
–Omid Sojoodi，LabVIEW FPGA 与实时总监
PLDA，赛灵思联盟计划成员
“PLDA 是 FPGA PCI、USB 以及 TCP/IP IP 的业界领先公司，拥有广泛的客户群。我们看到Vivado IP 封装器具有极高的性能价值，可以便捷把我们深受欢迎的 IP添加到 Vivado 可扩展 IP 目录之中，从而让赛灵思的用户更容易地使用我们的各种产品。购买我们 IP 的公司现在可通过新的途径将其统一部署在他们的整个机构中，从而提升客户的生产力与产品质量。”
–Stephane Hauradou，首席技术官
Synopsys 公司，赛灵思联盟计划成员
“我们同赛灵思密切合作，优化我们的 Synplify® 综合产品，以实现与 V大电流电感ivado 设计套件的配合使用。Vivado 工具与 Synplify Premier 结合后，实现 FPGA 一体成型电感器与 FPGA 原型的设计人员将可获得完整高效 FPGA 设计流程的优势，以显著缩短的设计周期实现最高质量的绩效成果。”
–John Koeter，IP 市场营销副总裁
Atrenta 公司，赛灵思联盟计划成员
“随着行业在生产设计中将更多采用 FPGA，Atrenta 与赛灵思的合作，将为我们集中精力在 SpyGlass 与 Vivado 设计套件之间模压电感实现互操作性提供良好的机遇，同时也可为 FPGA 设计人员带来一种新的工作方法。在使用 RTL linting、跨时钟域 (CDC) 以及 ASIC 设计时序限制领域公认的业界领先平台 Atr高频电感器enta SpyGlass 时，最新 Vivado 设计套件将为采用赛灵思业界领先 FPGA 器件的客户带来与 ASIC 设计人员希望从 Atrenta 获得的相同的‘SpyGlass Clean’RTL 生产力优势。”
–Piyush Sancheti，高级业务开电感生产发总监
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